解语樱木

2026年9月，英特尔与ASML联合宣布了一个值得关注的数字：采用高数值孔径极紫外光刻（High-NA EUV）技术处理的晶圆累计量已突破100万片。

这不是实验室数据，而是涵盖设备认证、测试研发及部分产品层量产的实打实的产出。

全球采用High-NA EUV技术处理的晶圆总量是135万片。剩下的35万片来自台积电、三星、SK海力士等公司，主要用于测试和小规模生产。英特尔的100万片，几乎全部来自18A制程的量产线。

一个关键判断：英特尔在High-NA EUV这条新赛道上的领先优势，不是几个月，而是整整一代工艺节点的时间差。

为什么这么说？英特尔原计划在14A制程才导入High-NA EUV，结果在18A制程上就提前用了，比预定时间早了两年。两年，在半导体行业相当于一个完整的工艺节点周期。

这件事为什么重要？

High-NA EUV的核心变化在物镜的数值孔径，从0.33提升到0.55。通俗说，这台机器能在晶圆上刻出更细的线。更细的线意味着更高的晶体管密度、更低的制造复杂度，以及芯片性能和能效的潜在提升。

但这台机器不便宜。单台造价约4亿美元。目前全球已有4家客户完成装机的10台High-NA EUV系统投入运作，另有3台系统正在出货与装机中。英特尔在俄勒冈州部署了至少三台。

英特尔具体做了什么？

他们把High-NA EUV用在了Intel 18A制程的部分关键层上，生产的是代号“Panther Lake”的第三代酷睿Ultra处理器。这是全球首款实现High-NA EUV逻辑芯片高产量出货的产品。

更值得关注的是操作方式——英特尔没有把整个18A制程全部切换新设备，而是选择部分关键层试产，同时在传统0.33数值孔径EUV设备上完成相同层次的加工。直接对比两种技术路径的制造表现。

结果：采用High-NA EUV生产的18A层，性能持平甚至优于传统EUV平台对应的层级。

这对产业链意味着什么？

第一，良率与产能的确定性在提升。Intel 18A部分工艺层已完成High-NA EUV与现有EUV的“双重认证”——同一芯片层可在不同代际的光刻设备上互换生产，良率表现与成熟的NXE平台持平。这种跨平台兼容性，让英特尔在产线调度上有了更大弹性。

第二，成本结构可能发生变化。High-NA EUV的核心商业价值在于用单次曝光取代多重曝光。传统0.33 NA EUV需要多重曝光等复杂工艺，而0.55 NA的高分辨率可以直接减少光罩层数和缺陷率，缩短生产周期。

第三，AI芯片的制造瓶颈在松动。当前EUV光刻机使用6x6英寸光罩，芯片面积理论极限858mm²，英伟达的AI GPU几乎就是沿着这个极限在做。但High-NA EUV目前视场减半，理论芯片面积只有429mm²——这个面积做不了高性能AI芯片。

英特尔和ASML已经在合作解决这个问题：开发6x12英寸的大尺寸光罩，计划2031年试产、2033年量产。这个技术突破后，High-NA EUV最大的应用限制才能解除。

一个反常识的判断：台积电和三星的“谨慎”，可能不是保守，而是算不过账。

台积电董事长魏哲家亲自出面澄清，公司不仅没有不投资High-NA EUV，且早已购入设备，只是暂时不投入量产。原因是成本太高，现阶段生产中不需要。台积电正在努力降低成本，在投产前最大化设备的效益。

三星的路线更明确：2nm的SF2和1.4nm的SF1.4两个近期节点，High-NA EUV光刻图案化技术仍不算成熟，要到1nm级才计划实现商业应用。

两家巨头不是买不起，而是在算投入产出比。台积电的A13和A12制程甚至都不需要High-NA EUV。

但英特尔的逻辑不一样。

英特尔需要这场胜利。在10纳米制程遭遇瓶颈后，英特尔失去了长期的工艺领先优势。18A制程的Panther Lake是英特尔证明“制造能力回流”的关键产品。High-NA EUV的率先量产，是英特尔向代工客户传递的一个信号：这条技术路线，我跑通了。

未来趋势：技术路线的分化正在发生

ASML的规划很清晰：High-NA EUV在逻辑制程上能从2nm一路支援到0.7nm与0.5nm节点。机台可用率已提升至84%，年底目标90%。经认证的EXE:5200B系统在验收测试中已达到每小时135片晶圆的吞吐量。

但不同玩家的节奏完全不同。英特尔在18A就跑了100万片，台积电和三星要等到1nm级才大规模商用。这个时间差意味着什么？

意味着未来2-3年，High-NA EUV的量产经验、设备调试数据、工艺优化参数，只有英特尔手里有最完整的版本。

半导体制造从来不是“买了设备就能生产”的行业。设备装好了，工艺要调，参数要优化，良率要爬坡。这些都需要时间，需要真金白银的晶圆来喂。100万片晶圆的处理量，就是英特尔在这个技术路线上积累的“数据护城河”。

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